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No Patent No Titel
1 DE112005002659T5 Doppelzellenbitleitungserfassungskonfiguration
2 EP1673781 SPEICHERZELLENARRAY MIT GESTAFFELTER LOKALER VERBINDUNGSSTRUKTUR
3 DE60303721T2 Speichervorrichtung mit Speicherzelleinheiten aus einer Speicherzelle und einer komplementären Speicherzelle, und ein Leseverfahren
4 DE60206624T2 SEGMENTIERUNG DER BITLEITUNG UND DES STEUERGATES IN EINEM NICHTFLÜCHTIGEN SPEICHER
5 DE60023213T2 RAM Speicher
6 DE102004059723A1 Speicherbauelement mit neuer Anordnung der Bitleitungen
7 EP1398787 Speichervorrichtung mit Speicherzelleinheiten aus einer Speicherzelle und einer komplementären Speicherzelle, und ein Leseverfahren
8 DE102005043296A1 Halbleiterspeicherbauelement mit Signalleitungsanordnung
9 EP1067556 RAM Speicher
10 EP1397808 SEGMENTIERUNG DER BITLEITUNG UND DES STEUERGATES IN EINEM NICHTFLÜCHTIGEN SPEICHER
11 EP1610338 Segmentierung der Bitleitung und des Steuergates in einem nichtflüchtigen Speicher
12 EP1607979 Speicherarchitektur mit segmentierten Schreiblinien
13 DE102004032704A1 Integrierte Schaltung und Verfahren zum Betreiben einer integrierten Schaltung
14 EP1030311 Decoder-Anschlussanordnung für Speicherchips mit langen Bitleitungen
15 DE69822280T2 Halbleiterspeicher
16 EP1424697 Hochdichte 1T1R resistive RAM-Speichermatrix mit einer gemeinsamer Bitleitung und einer gemeinsamer Sourceleitung
17 EP1398786 Pseudo- Zweidimensionaler Speicher mit wahlfreiem Zugriff
18 EP0924709 Halbleiterspeicher
19 EP1387360 Kubische Speichermatrix
20 EP0896281 Datenbus in einem Rechnersystem
21 EP1347457 Synchroner selbstgetakteter lokaler SRAM-Block
22 EP1308957 Widerstandsanordnungdatenspeicher und Verfahren zu seiner Herstellung
23 EP1278197 Kompacter im Multiplexverfahren betriebener globaler Leseversterker für RAM-Speicher
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